Démultiplexeur

Démultiplexeur

Un démultiplexeur est un circuit combinatoire à N+1 entrées et 2N sorties. N entrées, appelées entrées d'adressage, permettent d'envoyer sur l'une des sorties la dernière entrée, appelée l'entrée donnée.

Un décodeur est un cas particulier dans lequel on relie l'entrée donnée du démultiplexeur à 1. Le décodeur est donc un circuit combinatoire à N entrées et 2N sorties. Sélectionner une sortie grâce aux entrées d'adressage la fera passer de l'état 1 à l'état 0.

Sommaire

Table de vérité

Table de vérité d'un décodeur 2 vers 4, les entrées sont C1C0 et les sorties S1, S2, S3, S4.

C1 C0 S1 S2 S3 S4
0 0 1 0 0 0
0 1 0 1 0 0
1 0 0 0 1 0
1 1 0 0 0 1

Schéma logique

Ci dessous, un démultiplexeur à 2 entrées et 4 sorties. La construction (voir les entrées des portes ET) suit la progression binaire : 00, 01, 10, 11.

Un démultiplexeur de 2 vers 4, montré dans les 4 états possibles.

Voir aussi

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Articles connexes


v · d · m
Technologies CPU
Architecture Architecture Harvard · Architecture de von Neumann · Taxinomie de Flynn (SISD · SIMD · MISD · MIMD)
Types Processeur de signal numérique · Microcontrôleur · System on Chip · Processeur vectoriel
Jeu d’instructions ISA : CISC · EDGE · EPIC · MISC · OISC · RISC · VLIW · ZISC · 8-bits · 16-bits · 32-bits · 64-bits · 128-bits
Parallélisme
Pipeline Pipelining · Exécution out-of-order · Renommage de registres · Exécution spéculative · Superscalaire
Processus Multithreading · Simultaneous multithreading · Hyperthreading · Signal d’horloge · Clock gating · processeur synchrone · asynchrone · autosynchrone · Ajustement dynamique de la fréquence · Overclocking
Microarchitecture UAL · Barrel shifter · FPU · Backside bus · Multiplexeur · Démultiplexeur · Registres · MMU · Translation lookaside buffer (TLB) · Cache · Banc de registres · Microcode · Unité de contrôle
Gestion de l’alimentation APM · ACPI (états) · Ajustement dynamique du voltage

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